计算机期末考试简答题复习与答案

计算机期末考试简答题复习1. 在定点机中采用单符号位，如何判断补码加减运算是否溢出，有几种方案？ 答：定点机中采用单符号位判断补码加减运算是否溢出有两种方案。(1) 参加运算的两个操作数 ( 减法时减数需连同符号位在每位取反， 末位加 1) 符号相同，结果的符号又与操作数的符号不同，则为溢出。(2) 求和时最高位进位与次高位进位异或结果为 1 时，则为溢出。2. 试比较RAM和ROM答：RAM是随机存取存储器，在程序的执行过程中既可读出又可写人ROM是只读存储器，在程序执行过程中只能读出信息，不能写人信息。3. 试比较静态RAM和动态RAM答：静态RAM和动态RAM都属随机存储器，即在程序的执行过程中既可读出又可 写人信息。但静态RAM靠触发器原理存储信息只要电源不掉电，信息就不丢失 ； 动态RAM靠电容存储电荷原理存储信息，即使电源不掉电，由于电容要放电，信 息也会丢失，故需再生。4. 存储器的主要功能是什么 ?如何衡量存储器的性能？为什么要把存储系统分成 若干不同的层次？主要有哪些层次 ?答：存储器的主要功能是存放程序或各类数据。 通常用存储容量、 存取周期以及 存储器的带宽 (每秒从存储器读出或写入二进制代码的位数 ) 三项指标来反映存 储器的性能。 为了扩大存储器容量和提高访存速度， 将存储系统分成若于不同层 次，有Cache-主存层次和主存-辅存层次。前者为使存储器与 CPUS度匹配， 在CPU和主存之间增设Cache高速缓冲存储器，其容量比主存小，速度比主存快， 用来存放CPU最近期要用的信息，CPU可直接从Cache中取到信息，从而提高了 访存速度。后者为扩大存储器容量， 把主存和辅存统一成一个整体， 从整体上看， 速度取决于主存，容量取决于辅存，称为虚存。 CPL只与主存交换信息，但程序 员可用指令地址码进行编程，其位数与虚存的地址空间对应。5. 什么是刷新？刷新有几种方式？简要说明之答:动态RAM靠电容存储电荷原理存储信息，电容上的电荷要放电，信息即丢失。 为了维持所存信息，需在一定时间（2 ms），将所存信息读出再重新写人（恢复）, 这一过程称为刷新，刷新是一行一行进行的，由 UPU自动完成。刷新通常可分集中刷新和分散刷新两种。集中刷新即在 2 ms 时间，集中一 段时间对存储芯片的每行刷新一遍， 在这段时间里不能对存储器进行访问， 即所 谓死时间。分散刷新是将存储系统周期分为两半，前半段时间用来进行读 / 写操 作，后半段时间用来进行刷新操作， 显然整个系统的速度降低了， 但分散刷新没 有存储器的死时间。还可将这两种刷新结合起来，即异步刷新，这种刷新可在 2ms时间对存储芯片的每一行刷新一遍，两行之间的刷新间隔时间为2ms/芯片的 行数。6. 存储芯片的地址译码有几种方式？是分析它们各自的特点及应用场合。 答：存储芯片的地址译码有两种方式， 一种是线选法， 适用于地址线较少的芯片。 其特点是地址信号只须经过一个方向的译码就可选中某一存储单元的所有位。 另 一种是重合法 （双重译码），适用于地址线较多的芯片。 其特点是地址线分成两组， 分别经行、列两个方向译码，只有行、列两个方向均选中的存储元才能进行读 / 写。7. 简述主存的读 /写过程答：主存储器的读出过程是:CPU先给出地址信号，然后给出片选（通常受CPU访 存信号控制 ） 信号和读命令，这样就可将被选中的存储单元的各位信息读至存储 芯片的数据线上。主存储器的写人过程是:CPU先给出地址信号，然后给出片选（通常受CPU访 存信号控制 ）信号和写命令，并将欲写人的信息送至存储器的数据线上，这样， 信息便可写人到被选中的存储单元中。8. 提高访存速度可采取哪些措施？ 答： 提高访存速度可采取三种措施。（1）采用高速器件，选用存取周期短的芯片，可提高存储器的速度 采用Cache , CPU将最近期要用的信息先调人 Cache,而Cache的速度 比主存快得多，这样CPU每次只需从Cache中取出（或存人）信息，从而缩短了访 存时间，提高了访存速度。（3）调整主存结构，如采用单体多字结构 （在一个存取周期读出多个存储字， 可增加存储器的带宽 ），或采用多体结构存储器 （参考第 16题答案） 。9. 什么是快速缓冲存储器，它与主存有什么关系？答:快速缓冲存储器是为了提高访存速度，在CPU和主存之间增设的高速存储器， 它对用户是透明的。只要将 CPU最近期需用的信息从主存调人缓存，这样CPU每次只需访问快速缓存就可达到访问主存的目的， 从而提高了访存速度。 主存的 信息调人缓存要根据一定的算法，由CPU自动完成。凡是主存和缓存已建立了对 应关系的存储单元， 它们的容必须保持一致， 故凡是写人缓存的信息也必须写至 与缓存单元对应的主存单元中 .10. 什么是“程序访问的局部性”？存储系统中哪一级采用了程序访问的局部性 原理？ 答:所谓程序访问的局部性即程序执行时对存储器的访问是不均匀的， 这是由于 指令和数据在主存的地址分布不是随机的， 而是相对地簇聚。 存储系统的 Cache- 主存级和主存-辅存级都用到程序访问的局部性原理。对 Cache-主存级而言，把 CPU最近期执行的程序放在容量较小、速度较高的Cache中。对主存-辅存级而言，把程序中访间频度高、 比较活跃的部分放在主存中， 这样既提高了访存的速 度又扩大了存储器的容量。11. 使用4K*8位的RAM芯片组成一个容量为8K*16位的存储器，画出结构框 图，并标明途号线的种类、方向和条数。答：用4片4KX 8位的RAM芯片可组成容量为8KX 16位的存储器，其结构框图 如图 5.1 所示。A%R7W412. 设CPU共有16根地址线，8根数据线，并用作为访存控制信号（低电平 有效），用作为读/写控制信号（高电平为读，低电平为写）。现有下列存储芯片： 1K*4位RAM 4K*8位RAM 2K*8位ROM以及74138亿马奇和各种门电路，如图 4.14所示。画出CPU与存储芯片的连接图，要求：（1）主存地址空间分配：8000H-87FFH微系统程序区；8800H-8BFFH为用户 程序区。（2）合理选用上述存储芯片，说明各选几片。（3）详细画出存储芯片的片选逻辑。答：根据主存地址空间分配，选出所用芯片类型及数量。即A15AnAA A10000000000000002KX 8 位 ROM 1 片100010111111111110001000000000001KX 4 位 RAM茁1 0 0 0 1 0 1 1 1 1 1 1 1 1 1 11 0 1 0 1 1 0 0 0 0 0 0 0 0 0 0 1K1 0 1 0 1 1 1 1 1 1 1 1 1 1 1 1X 4位RAM茁图5.2第11题答案CPU与存储芯片的连接图如图5.2所示。13. 在32题给出的条件下，画出CPU与存储芯片的连接图，要求；（1）主存地址空间分配：A000-A7FFH微系统程序区；A800H-AFFF为用户程 序区。（2）合理选用上述存储芯片，说明各选几片，并写出每片存储芯片的二进制 地址围。（3）详细画出存储芯片的片选逻辑。答：.根据主存地址空间分配，对应 A000HA7FF系统程序区，选用一片2K x 8位RAM芯片；对应A80f1H 一 AFFFH用户程序区，选用 4片1K x4位RAM芯片每片存储芯片的地址围如下。CPU与存储芯片的连接图如图5.3所示A15 Aii1 0 1 0 0 0 0 0 0 0 0 0 0 0 0 0 2K1 0 1 0 0 1 1 1 1 1 1 1 1 1 1 11 0 1 0 1 0 0 0 0 0 0 0 0 0 0 0 1KX 8 位 ROM 1片X4位RAM茁1 0 0 0 0 0 0 0 0 0 0 1KX4位RAM茁3 1 AlAJAd2KX89 1lKX4ft RAM3ClKX4fi1KX4&RAM1 0 1 0 1 0 1 1 1 1 1 1 1 1 1 1图5.3 第12题答案14. 一个较完善的指令系统应包括哪几类指令？答：包括数据传送指令、算术运算指令、逻辑运算指令、程序控制指令、输入/输出指令、堆栈指令、字符串操作指令、特权指令等。15. 在寄存器-寄存器型、寄存器-存储器型和存储器-存储器型三类指令中，哪 类指令的执行时间最长？哪类指令的执行时间最短？为什么？答：寄存器-寄存器型执行速度最快。存储器-存储器型执行速度最慢。因为前者操作数在寄存器中，后者操作数在存储器中。而访问一次存储器所 需要的时间一般比访问一次寄存器所需要的时间长。16. 简述微程序控制器和组合逻辑（硬布线）控制器哪一种速度更快？为什么？ 答：组合逻辑（硬布线）控制器的速度更快。因为微程序控制器使每条机器指令都转化为一段微程序，并存储在控制存 储器。微操作序列有微指令形成。增加了一级控制存储器，所以速度变慢。17. 指令和数据均放在主存中，CPU如何从时间和空间两个方面对它们加以区 别？答：从时间上将，取指令事件发生在“取指周期”，取数据事件发生在“执行周期”。从空间上讲，从存读出指令流流向控制器的指令寄存器IR，从存读出数据流流向运算器的通用寄存器。18.1/0的编址方式有几种？各有何特点？答：I/O设备的编址方式有两种：统一编址和不统一编址（单独编址）。所谓统一编址即在主存地址空间划出一定的围作为 I/O地址，这样通过访存指令即可实 现对I/O的访问，但是主存容量相应减少。所谓不统一编址即I/O和主存的地址 是分开的，I/O地址不占主存空间，故这种编址不影响主存容量，但访问 I/O时 必须有专用的I/O指令。19. I/O与主机交换信息有哪几种控制方式？各有何特点？答：主机与I/O交换信息的控制方式有：（1）程序查询方式。其特点是主机与I/O串行工作。CPU启动I/O后，时 刻查询I/O是否准备好，若设备准备就绪，CPU便转入处理I/O与主机间传送信 息的程序；若设备未做好准备，则 CPU反复查询，“踏步”等待直到I/O准备就 绪为止。可见这种方式CPU效率很低。（2）程序中断方式。其特点是主机与I/O并行工作。CPU启动I/O后，不 必时刻查询 I/O 是否准备好，而是继续执行程序。当 I/O 准备就绪时，向 CPU 发中断请求信号，CPU在适当的时候响应I/O的中断请求，暂停现行程序为I/O 服务。这种方式消除了“踏步”现象，提高了 CPU的效率。（3）DMA方式。其特点是主机与I/O并行工作，主机与I/O之间有一条直 接数据通路。CPU动I/O后，不必查询I/O是否准备好（4） 通道方式。通道是一个具有特有功能的处理器， CPU把部分权利下放给通 道，由它实现对外围设备的统一管理和外围设备与主存之间的数据交换， 大大提 高了 CPU的效率，但它是以花费更多的硬件为代价的。（5） I/O处理机方式。它是通道方式的进一步发展，CPU将I/O操作及外围设备 的管理权全部交给 I/O 处理机，其实质是多机系统，因而效率有更大提高。20. 一般小型或微型机中， I/O 与主机交换信息由几种方式？各有何特点？哪种 方式CPU效率最高？答：在小型或微型机中， I/O 与主机交换信息有三种方式：程序查询方式、程序 中断方式、和DMA方式，其中DMA方式CPU效率最高。三种方式的特点详见上题 答案。21. 什么是通道？通道的基本功能是什么？ 答：通道是一个具有特殊功能的处理器， 它有自己的指令和程序， 专门负责数据 输入输出的传输控制（CPU把传输控制功能下放给通道）。通道受CPU的 I/O指 令启动、停止或改变其工作状态。通道的基本功能是按 I/O 指令要求启动 I/O 设备，执行通道指令，组织I/O设备和主存进行数据传输，向CPU报告中断等。22. 画图比较程序查询方式、程序中断方式和 DMA方式的CPUX作效率。.答：程序查询方式、程序中断方式和DMA方式的CPUX作效率如图8.1所示。由 图可见，DMA方式的工作效率最高，程序中断方式其次，程序查询方式最低。